工作职责:
负责从RTL 到GDS signoff的后端设计工作, 包括:
一、前端逻辑综合,包括RTL Spyglass check,sdc创建,logic synthesis,形式验证等
二、DFT 设计,包括JTAG,BIST,SCAN,IP test等
三、后端实现设计,包括Floorplan, Placement, CTS,Route,STA, Power分析,SI分析等
四、 Physical verification, 包括DRC/LVS/ERC
职位要求:
一、集成电路,微电子等相关专业领域本科或硕士。
二、具有相关实习经验者优先
三、熟悉数字电路、模拟电路、Verilog、半导体物理理论、器件、制造工艺、DFT、系统集成;了解EDA软件、sc语言,集成电路设计流程等
四、英语四级以上
五、具有团队合作精神及良好的沟通能力
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